奔驰彩票微信群群主,FPGA个人学习总结

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资料介绍

  1. 综合方面

  1) 经综合后:

  普通的数据单端输入都会加一个IBUF缓冲器;

  数据单端输出有个OBUF缓存器;

  时钟输入口会加BUFGP缓冲器;

  对于4选1的mux,if结构和case结构都只需要一个slice,由MUXF5控制两个LUT....

  2.LUT的名字后_数字,那个数字代表什么意思?

  LUTa_b:a代表所有输入数据位宽,即输入数据的个数,切勿将位宽理解为“每个输入端口的数据宽度(因每个输入端口是单bit输入);b代表LUT被初始化的状态

  3.比较器位宽大小对综合结构的影响

  当比较的位宽高于一定位数时,综合会采用进位链结构,如下图:

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